图A所示是用CMOS电路J-K触发器组成的除2加法计数线路,表A是其真值表。
图B所示是除3加法计数线路,表B是其真值表。
图A 图B
表A(上)表B(下)
图C所示是除4加法计数线路,表C是其真值表。
图D所示是除5加法计数线路,表D是其真值表。图中RS端均接低电压。
图C 图D
表C(上) 表D(下)
免责声明: 凡注明来源本网的所有作品,均为本网合法拥有版权或有权使用的作品,欢迎转载,注明出处。非本网作品均来自互联网,转载目的在于传递更多信息,并不代表本网赞同其观点和对其真实性负责。
74系列数字电路7416.74LS16等六反相缓冲器/驱动器(OC.高压输出)
日期:2008-10-14
74系列数字电路74H183.74LS183双进位保存全加器
日期:2008-10-19
74系列数字电路74150,74HC150等16选1数据选择器(反相)
日期:2008-10-18
电路引脚及主要特性MC3335 窄带FM接收妻
日期:2008-11-27
二极管-晶体管或非门电路图
日期:2009-06-22