利用EPLD实现TMS320C5402与SDRAM接口

摘 要： 介绍了基于电可擦除可编程逻辑器件 EPLD，用VHDL语言设计实现的TMS320C5402与
SDRAM的接口电路。
关键词： 电可擦除可编程逻辑器件 数字信号处理器 同步动态随机存储器 接口电路 VHDL

在多媒体应用中，多媒体信息绝大部分是视频数据和音频数据，而数字化的视频数据和音频数据的数据量是非常庞大的。为了能够及时完整地处理前端采集的数据，一般系统都采用高速DSP和大容量缓冲存储器，且缓冲存储器一般选用同步动态随机存储器(SDRAM)。由于DSP不能直接与SDRAM接口，而且SDRAM控制时序比较复杂，因此本文介绍如何利用电可擦除可编程逻辑器件实现TMS320C5402与SDRAM的接口。

在具体操作SDRAM时，首先必须通过MRS命令设置模式寄存器，以便确定SDRAM的列地址延迟、突发类型、突发长度等工作模式；再通过ACT命令激活对应地址的组，同时输入行地址；然后通过RD或WR命令输入列地址，将相应数据读出或写入对应的地址；操作完成后用PCH命令或BT命令中止读或写操作。在没有操作的时候，每32ms必须用ARF命令刷新数据(2048行)，防止数据丢失。

2 FLEX10K系列EPLD特点
FLEX10K系列EPLD是工业界个嵌入式的可编程逻辑器件，主要由嵌入式阵列块(EAB)、逻辑阵列块(LAB)、快速布线通道(FastTrack)和I/O单元组成，具有如下特点：
(1)片上集成了实现宏函数的嵌入式阵列和实现普通函数的逻辑阵列；
(2)具有10000～250000个可用门；
(3)支持多电压I/O接口，遵守PCI总线规定，内带JTAG边界扫描测试电路；
(4)可快速预测连线延时的快速通道连续式布线结构；
(5)多达6个全局时钟信号和4个全局清除信号；
(6)增强功能的I/O引脚，每个引脚都有一个独立的三态输出使能控制，都有漏极开路选择。

3.1 命令接口和刷新控制电路设计
命令接口电路主要由命令寄存器、命令译码器、SDRAM行列地址锁存器、模式寄存器组成。其中命令寄存器映射为DSP的I/O空间0001H，SDRAM行和列地址锁存器分别映射为DSP的I/O空间0002H和0003H，模式寄存器映射为DSP的I/O空间0004H，具体控制命令和I/O地址分配如表2、表3所示。

PORT MAP data ＜＝ LPM_WIDTH-1 DOWNTO 0　；
wreq ＜＝ wr；rreq ＜＝ rd；
clock ＜＝ clk50；clockx2 ＜＝ clk100；
clr ＜＝ clr；sclr ＜＝ sclr；
empty ＜＝ empty；full ＜＝ full；
q＜＝qLPM_WIDTH-1 DOWNTO 0　　；
由于EPLD通用、高速及价廉的特点，因此具有很好的实际应用前景，尤其适用于需要大容量高速缓冲存储器的多媒体应用。